طراحی، شبیه سازی و ارزیابی یک سلول تمام جمع کننده سه ارزشی برمبنای ترانزیستورهای نانولوله کربنی- نسخه چهار: بهبود سرعت، مصرف توان و تحمل پذیری نویز
سال انتشار: 1396
نوع سند: مقاله ژورنالی
زبان: فارسی
مشاهده: 347
فایل این مقاله در 12 صفحه با فرمت PDF قابل دریافت می باشد
- صدور گواهی نمایه سازی
- من نویسنده این مقاله هستم
استخراج به نرم افزارهای پژوهشی:
شناسه ملی سند علمی:
JR_SASE-3-1_021
تاریخ نمایه سازی: 15 اردیبهشت 1397
چکیده مقاله:
با توجه به لزوم ادامه روند مجتمع سازی با بهره گیری از فناوریهای نوین و نقش بیبدیل جمع کننده ها در سیستمهای VLSIو همچنین مزایای بیشمار منطق چند ارزشی، دستاوردهای این مقاله در راستای بهبود بخشیدن به سرعت، مصرف توان و حاشیه نویز جمع کنندههای سه ارزشی مبتنی بر ترانزیستورهای نانولوله کربنی هدف گذاری شده است. در این میان اما کاهش حاشیه نویز بر اثر استفاده از منطق چند ارزشی قابل تامل به نظر میرسد، لذا لزوم استفاده حداکثری از فضای ولتاژ کاری و فراهم آوردن حداکثر بازه قابل دسترس برای هر منطق به فراخور ظرفیتهای موجود به منظور افزایش تحمل پذیری مدار در برابر نویز ضروری به نظر میرسد. از این رهگذر بر آن شدیم تا طرح پیشنهادی نه تنها دارای تاخیر و توان مصرفی مناسب باشد، بلکه از مصونیت مناسبی در برابر نویز نیز برخوردار باشد. در کنار این موضوع، ما بر روابط ریاضی حاکم بر ترانزیستورهای نانولوله کربنی نیز مروری خواهیم داشت.
کلیدواژه ها:
نویسندگان
مهراد آفرین
کارشناسی ارشد مهندسی کامپیوتر- معماری سیستم های کامپیوتری، دانشگاه آزاد اسلامی واحد شهرری، تهران، ایران