طراحی ضرب کننده 16 بیت با استفاده از تکنیک پایپ لاین و با سرعت 6 گیگا هرتز بااستفاده از مدارات cmos
سال انتشار: 1396
نوع سند: مقاله کنفرانسی
زبان: فارسی
مشاهده: 757
فایل این مقاله در 5 صفحه با فرمت PDF قابل دریافت می باشد
- صدور گواهی نمایه سازی
- من نویسنده این مقاله هستم
استخراج به نرم افزارهای پژوهشی:
شناسه ملی سند علمی:
BPJ03_044
تاریخ نمایه سازی: 29 مهر 1396
چکیده مقاله:
این مقاله هدف طراحی یک ضرب کننده 16*16 می باشد. در این ضرب کننده برای افزایش سرعت از تکنیک پایپ لاین استفاده کرده ایم طوری که با اضافه کردن المان های تاخیر در مسیرهای مورد نظر مسیر بحرانی را کاهش داده ایم و سرعت مدار را به حداکثر رسانده ایم.در این ضرب کننده از روش بوث سلکتور استفاده کرده ایم. بررسی کارایی ضرب کننده با استفاده از نرم افزار HSPICE در تکنولوژی 0.18 میکرو شبیه سازی شده است
کلیدواژه ها:
نویسندگان
پریا پاکمهر
دانشجو، دانشگاه ارومیه