ارزیابی مدار پمپ شارژ PLL با استفاده از تکنولوژی CMOS50 نانومتر
محل انتشار: سومین کنفرانس ملی مهندسی برق ایران
سال انتشار: 1394
نوع سند: مقاله کنفرانسی
زبان: فارسی
مشاهده: 867
فایل این مقاله در 7 صفحه با فرمت PDF قابل دریافت می باشد
- صدور گواهی نمایه سازی
- من نویسنده این مقاله هستم
استخراج به نرم افزارهای پژوهشی:
شناسه ملی سند علمی:
INCEE03_106
تاریخ نمایه سازی: 11 آبان 1395
چکیده مقاله:
توضیح سیویلیکا: اطلاعات مقاله طبق درخواست 41546حذف گردید.]یک مدار سیگنال مختلط PLLاست که مستلزم چالش طراحی در فرکانس بالا است. این کار طرح سیگنال مختلط حلقه قفل فاز را برای قفل فرکانس و فازسریعتر بررسی می کند. عملکرد بار الکتریکی پمپ ها بستگی به سنگینی توانایی به طور موثر دارد که ولتاژهای بالا را روی تراشه تولید می کند ؛در حالیکه نیروی سخت و شرایط سطح را اتصال میدهد. این مقاله سرعت بالای مدار پمپ شارژCMOS را برای کاربردهای PLL با استفاده از تکنولوژی CMOS 50 nm نشان می دهد که درIV عمل می کند. مدل پیشنهادی دارای ساختار متقارن ساده است و عملکرد بسیار ثابتی را فراهم می کند در حالیکه جهت نادرست پدیده را کاهش می دهد. ولتاژ خروجی طرح موجود می تواند تاmV1015 زیاد شود. قابلیت پمپ شارژ بر اساس فرکانس عملیاتیMHZ400 آزمایش شده است.
کلیدواژه ها:
آشکار ساز فاز فرکانسPFD/فیلتر حلقه ای ، اسیلاتور کنترل شده با ولتاژVCO/حلقه قفل فاز PLLs
نویسندگان
طاهره بویری
دانشجوی کارشناسی ارشد دانشگاه آزاد اسلامی ،بوشهر،ایران
مراجع و منابع این مقاله:
لیست زیر مراجع و منابع استفاده شده در این مقاله را نمایش می دهد. این مراجع به صورت کاملا ماشینی و بر اساس هوش مصنوعی استخراج شده اند و لذا ممکن است دارای اشکالاتی باشند که به مرور زمان دقت استخراج این محتوا افزایش می یابد. مراجعی که مقالات مربوط به آنها در سیویلیکا نمایه شده و پیدا شده اند، به خود مقاله لینک شده اند :