یک الگوریتم نگاشت حین اجرای آگاه از قابلیت اطمینان برای بهبود توان عملیاتی سیستم روی تراشه های چند هسته ای مبتنی بر شبکه روی تراشه

سال انتشار: 1398
نوع سند: مقاله کنفرانسی
زبان: فارسی
مشاهده: 438

فایل این مقاله در 15 صفحه با فرمت PDF قابل دریافت می باشد

استخراج به نرم افزارهای پژوهشی:

لینک ثابت به این مقاله:

شناسه ملی سند علمی:

CEITCONF03_055

تاریخ نمایه سازی: 6 خرداد 1399

چکیده مقاله:

اخیرا کوچک سازی بسیار زیاد ترانزیستورها، با چگالی توان بالا و دمای زیاد تراشه همراه بوده است که این امر موجب تسریع روند سالخوردگی و فرآیند فرسایش دستگاه گشته است. سیستم روی تراشه های چند هسته ای نیز از این امر مستثنی نبوده و مساله ی حرارت تراشه و اثرات آن در بلند مدت، چنین دستگاه هایی را بیشتر در معرض پدیده ی سالخوردگی قرار داده است. با افزایش نرخ خرابی برخواسته از اثرات پدیده های سالخوردگی همچون جابه جایی الکتریکی، افت قابلیت اطمینان طول عمر به چالشی محدود کننده برای محققان و طراحان در بسترهای محاسباتی همانند سیستم روی تراشه های چند هسته ای مبدل گردیده است. در این پژوهش یک تکنیک نگاشت حین اجرای آگاه از قابلیت اطمینان با محدودیت طول عمر تحت عنوان LaSA ارائه شده است. هدف از ارائه ی این الگوریتم، گسترش طول عمر از طریق ایجاد تعادل میان بهره وری هسته های سیستم و استفاده از تمام منابع دردسترس به منظور بهبود توان عملیاتی یک سیستم روی تراشه ی چند هسته ای میباشد. الگوریتم LaSA با کاهش 3/12درصدی و 56درصدی وارایانس پارامتر مقیاس هسته ها نسبت به الگوریتم های نگاشت آگاه از قابلیت اطمینان مبتنی بر نگاشت وظایف در ناحیه ی مربعی شکل LBC و LBC+LBL ،به ترتیب منجر به بهبود 1/2درصدی و 5/2درصدی زمان مورد انتظار تا وقوع اولین خرابی سیستم (TTFF (گردیده است. همچنین الگوریتم نگاشت پیشنهاد شده در این مقاله با محدود نبودن به نگاشت وظایف در ناحیه ی مربعی شکل سبب بهبود 3درصدی و 7درصدی توان عملیاتی سیستم به ترتیب در مقایسه با الگوریتم های نگاشت LBC و LBL+LBC گشته است.

نویسندگان

زینب کریم زاده

دانشجوی مقطع کارشناسی ارشدبخش مهندسی کامپیوتر، دانشکده فنی و مهندسی، دانشگاه شهید باهنر کرمان، کرمان، ایران

مجید محمدی

عضو هیئت علمی (دانشیار)، بخش مهندسی کامپیوتر، دانشکده فنی و مهندسی، دانشگاه شهید باهنر کرمان، کرمان، ایران